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如何更改Quartus II默認的5000次整數迭代

[英]How to change Quartus II default 5000 integer iterations

原文 2019-02-19 05:52:41 8 1 compilation/ verilog/ intel/ fpga/ quartus

Error（13356）循環必須在5000次迭代內終止Quartus II

1 個解決方案

通過以下方式更改迭代限制：

分配->設置->編譯設置->高級設置（綜合）->恆定Verilog循環的迭代限制

版本：18.1

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