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Vivado中的自動語法檢查不適用於測試平台嗎？

[英]Automatic syntax checking in Vivado doesn't work for testbenches?

原文 2017-05-12 08:23:39 9 1 vhdl/ vivado/ syntax-checking/ test-bench

當我在Vivado（項目模式）下編輯VHDL測試台（模擬源）時，似乎禁用了后台語法檢查：明顯的語法錯誤（例如，缺少分號或未定義的信號）未用紅線標記（與所有設計源一樣）。

有沒有一種方法可以激活測試平台的自動背景語法檢查？ 不對某些文件進行語法檢查還有其他原因嗎？

1 個解決方案

這似乎是缺少的功能： Xilinx論壇：VHDL測試平台的不語法突出顯示

Vivado 不確認測試台文件的更改

[英]Vivado doesn't acknowledge changes of testbench file

VHDL / vivado語法錯誤

[英]VHDL/vivado syntax errors

如何在沒有完全合成的情況下在Vivado中語法檢查VHDL

[英]How to syntax check VHDL in Vivado without complete synthesis

VHDL-庫不起作用

[英]VHDL - library doesn't work

為什么INOUT不起作用？

[英]Why the INOUT doesn't work?

為VHDL設計運行多個測試平台

[英]Running multiple testbenches for VHDL designs

如何管理大型VHDL測試平台

[英]How to manage large VHDL testbenches

整數比較在if語句（vhdl）中不起作用

[英]integer comparison doesn't work in if statement (vhdl)

位序列檢測器計數器不起作用（VHDL）

[英]Bitsequence detector counter doesn't work (VHDL)

VHDL簡單代碼不起作用

[英]VHDL simple code doesn't work

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